Basics of VLSI Design 7

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응용 프로그램은 다이어그램과 그래프와 VLSI의 완전한 무료 핸드북입니다. 그것은 주제에 중요한 주제, 노트, 뉴스 및 블로그를 제공하는 전자 및 통신 공학 교육의 일부입니다. 이 전자 및 통신 엔지니어링 주제에 대한 빠른 참조 가이드 및 전자 책으로 응용 프로그램을 다운로드합니다. 이 앱은 VLSI 디자인의 90개 이상의 주제를 자세히 다룹니다. 이 항목은 5 단위로 나뉩니다. 당신은 매우 쉽게 통과하고 시험이나 인터뷰에서 성공 할 수 있습니다, 응용 프로그램은 상세한 플래시 카드와 같은 주제에 대한 빠른 개정 및 참조를 제공합니다. 각 항목은 다이어그램, 방정식 및 기타 형태의 그래픽 표현으로 완성되어 쉽게 이해할 수 있습니다. 이 응용 프로그램에서 다루는 항목 중 일부는 다음과 같습니다. 1. 반도체 추억 :소개 및 유형 2. 메모리 만 읽기 (ROM) 3. 트랜지스터 DRAM 셀 3개 4. 트랜지스터 DRAM 셀 1개 5. 플래시 메모리 6. 낮은 - 전원 CMOS 논리 회로 : 소개 7. CMOS 인버터 설계 8. MOS 인버터 : 스위칭 특성 소개 9. 스캔 기반 기술 10. 내장 자기 테스트 (BIST) 기술 11. VLSI 디자인의 역사적 전망 : 무어의 법칙 12. CMOS 디지털 회로 유형 분류 13. 회로 설계 예 14. VLSI 설계 방법론 15. VLSI 디자인 흐름 16. 디자인 계층 구조 17. 규칙성, 모듈성 및 지역성의 개념 18. CMOS 제작 19. 제조 공정 흐름 : 기본 단계 20. nMOS 트랜지스터 의 제조 21. CMOS 제작 : p-웰 공정 22. CMOS 제작 : n-웰 공정 23. CMOS 제작 : 트윈 욕조 공정 24. 스틱 다이어그램 및 마스크 레이아웃 디자인 25. MOS 트랜지스터 : 물리적 구조 26. 외부 바이어스 아래의 MOS 시스템 27. MOSFET의 구조 및 운영 28. 임계값 전압 29. MOSFET의 전류 전압 특성 30. 모스트 스케일링 31. 스케일링의 효과 32. 작은 기하학 효과 33. 모스 커패시턴스 34. 모스 인버터 35. MOS 인버터의 전압 전송 특성 (VTC) 36. n형 MOSFET 부하가 있는 인버터 37. 저항 하중 인버터 38. 고갈 부하 인버터 설계 39. CMOS 인버터 40. 시간 정의 지연 41. 지연 시간 계산 42. 지연 제한이있는 인버터 디자인 : 예 43. 조합 MOS 로직 회로 : 소개 44. 고갈 nMOS 하중을 가진 MOS 로직 회로 : 두 입력 NOR 게이트 45. 고갈 nMOS 하중을 가진 MOS 로직 회로 : 여러 입력이있는 일반화 NOR 구조 46. 고갈 nMOS 하중을 가진 MOS 로직 회로 : NOR 게이트의 일시적 분석 47. 고갈 nMOS 하중을 가진 MOS 로직 회로 : 2 입력 NAND 게이트 48. 고갈 nMOS 하중을 가진 MOS 로직 회로 : 여러 입력이있는 일반화 된 NAND 구조 49. 고갈 nMOS 하중을 가진 MOS 로직 회로 : NAND 게이트의 일시적 분석 50. CMOS 로직 회로 : NOR2 (두 입력 NOR) 게이트 51. CMOS 낸드2 (두 입력 낸드) 게이트 52. 간단한 CMOS 로직 게이트의 레이아웃 53. 복잡한 로직 회로 54. 복잡한 CMOS 로직 게이츠 55. 복잡한 CMOS 로직 게이트의 레이아웃 56. AOI 및 OAI 게이트 57. 의사 nMOS 게이츠 58. CMOS 풀 더러 회로 및 캐리 리플 가산기 59. CMOS 전송 게이트 (패스 게이트) 60. 보완 패스 트랜지스터 로직 (CPL) 61. 순차적인 MOS 로직 회로 : 소개 62. 쌍안정 요소의 동작 63. SR 래치 회로 64. 클럭 SR 래치 65. 클럭 JK 래치 66. 마스터 슬레이브 플립 플롭 67. CMOS D-래치 및 에지 트리거 플립 플롭 68. 동적 논리 회로 : 소개 69. 패스 트랜지스터 회로의 기본 원칙

버전 기록

  • 버전 5.1 에 게시 2016-07-18
    아름다운 응용 프로그램 로고 및 버그 수정.

프로그램 세부 정보